发明名称 |
-Method and control circuit for jitter buffers |
摘要 |
<p>Zur Regelung eines Jitterpuffers (JP) werden pufferungsbedingte Übertragungsverzögerungen (dp) von Datenpaketen (DP1, DP2, DP3) erfasst. Aus erfassten Übertragungsverzögerungen (dp) werden gewichtete Verzögerungsmittelwerte (d1) fortlaufend abgeleitet, wobei eine geringere Übertragungsverzögerung stärker gewichtet wird als eine höhere Übertragungsverzögerung. Abhängig von den fortlaufend abgeleiteten gewichteten Verzögerungsmittelwerten (d1) wird dann eine Auslesegeschwindigkeit (CLK) des Jitterpuffers (JP) so geregelt, dass die gewichteten Verzögerungsmittelwerte (d1) als Regelgröße auf eine vorgegebene Sollverzögerung (sd1) eingeregelt werden.
</p> |
申请公布号 |
EP1460810(A3) |
申请公布日期 |
2009.06.17 |
申请号 |
EP20040100308 |
申请日期 |
2004.01.29 |
申请人 |
SIEMENS AKTIENGESELLSCHAFT |
发明人 |
BAUER, WOLFGANG;FALLY, GERHARD |
分类号 |
H04L12/801;H04L12/835;H04L12/841 |
主分类号 |
H04L12/801 |
代理机构 |
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代理人 |
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主权项 |
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地址 |
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