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发明名称 DEVICE AND METHOD FOR VERIFYING LOGIC CIRCUIT
摘要
申请公布号 JPH08329124(A) 申请公布日期 1996.12.13
申请号 JP19950134137 申请日期 1995.05.31
申请人 FUJITSU LTD;FUJITSU VLSI LTD 发明人 SAWADA SHINICHI
分类号 G06F17/50;(IPC1-7):G06F17/50 主分类号 G06F17/50
代理机构 代理人
主权项
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