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发明名称
用于动态预取缓冲器结构与替代之方法及装置
摘要
本发明揭示一种记忆体控制器(32)及其方法,其动态配置一预取缓冲器(30)以在不同丛发支援之多个汇流排主控器(12、14、16)与具有不同特征的多个记忆体之间进行连接。根据从该等汇流排主控器(12、14、16)之一接收一读取请求的该记忆体控制器,可修改该预取缓冲器(30)之至少一部分的一线路大小。最佳地替代预取缓冲器线路之一适应性方法,使用优先化状态(状态)栏位资讯以决定要替代何缓冲器线路。
申请公布号
TW200508861
申请公布日期
2005.03.01
申请号
TW093117961
申请日期
2004.06.21
申请人
飞思卡尔半导体公司
发明人
艾夫佐 玛立克;威廉C 莫伊尔
分类号
G06F12/00
主分类号
G06F12/00
代理机构
代理人
陈长文
主权项
地址
美国
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