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Der Speicher weist einen ersten differentiellen Leseverstärker (SA; SSA) auf mit Anschlüssen, die mit einem Datenleitungspaar (BLL, /BLL; DL, /DL) verbunden sind, über das der erste Leseverstärker bei einem Lesezugriff eine Information aus einer der Speicherzellen ausliest, um sie anschließend zu verstärken, und über das er bei einem Schreibzugriff eine Information in eine der Speicherzellen einschreibt, wobei die betreffende Information als Differenzsignale über das Datenleitungspaar übertragen werden und bei jedem Schreibzugriff vom ersten Leseverstärker zwischengespeichert werden. Außerdem weist der Speicher eine Schalteinheit (SW) auf, über die das Datenleitungspaar (BLL, /BLL) mit den Anschlüssen des ersten Leseverstärkers (SA) verbunden ist, zum Vertauschen der Leitungen des Datenleitungspaares bezüglich der Anschlüsse des ersten Leseverstärkers in Abhängigkeit ihres Schaltzustandes. Dabei wird der Schaltzustand der Schalteinheit (SW) während eines Schreibzugriffes wenigstens einmal geändert, so daß die einzuschreibende Information vom ersten Leseverstärker (SA) zunächst nicht invertiert und dann invertiert in die betreffende Speicherzelle (MC) eingeschrieben wird.
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