发明名称 | 半导体装置 | ||
摘要 | 本发明的实施方式提供一种能够减少读出用时钟与输出数据的同步的偏移的半导体装置。根据实施方式,半导体装置具备存储电路、第一FIFO、第二FIFO、及输入输出电路。所述存储电路输出数据。所述第一FIFO自所述存储电路接收数据,与第一时脉信号同步地输出数据。所述第二FIFO接收自所述第一FIFO输出的数据,与所述第一时脉信号同步地输出数据。所述输入输出电路输出自所述第二FIFO输出的数据。所述第二FIFO较第一FIFO更接近所述输入输出电路而配置。 | ||
申请公布号 | CN106201431A | 申请公布日期 | 2016.12.07 |
申请号 | CN201510553438.7 | 申请日期 | 2015.09.02 |
申请人 | 株式会社东芝 | 发明人 | 奥野晋也;长坂繁辉;小内俊之 |
分类号 | G06F5/06(2006.01)I | 主分类号 | G06F5/06(2006.01)I |
代理机构 | 北京律盟知识产权代理有限责任公司 11287 | 代理人 | 张世俊 |
主权项 | 一种半导体装置,其特征在于包括:存储电路,输出数据;第一先进先出电路,自所述存储电路接收数据,与第一时钟信号同步地输出数据;第二先进先出电路,接收自所述第一先进先出电路输出的数据,与所述第一时钟信号同步地输出数据;及输入输出电路,输出自所述第二先进先出电路输出的数据;且所述第二先进先出电路较第一先进先出电路更接近所述输入输出电路而配置。 | ||
地址 | 日本东京 |