发明名称 | 一种DC‑DC模块上电时序控制电路 | ||
摘要 | 本实用新型公开一种DC‑DC模块上电时序控制电路,其包括辅助输入电源、时序控制器、至少两个光耦、至少两个DC‑DC模块,辅助输入电源与时序控制器连接,时序控制器的TADJ引脚与GND引脚之间连接有电容,时序控制器的多个输出端口分别与至少两个DC‑DC模块的高电平有效控制输出端口一一对应连接,时序控制器的多个输出端口分别与上述光耦的正输入端一一对应连接,上述光耦的负输入端接地,至少两个光耦的正输出端分别与至少两个DC‑DC模块的低电平有效控制输出端口一一对应连接,上述光耦的负输出端接地。本实用新型电路可靠,简单实用,功耗低,通过驱动光耦的导通是对受控DC/DC模块的上电顺序进行控制。 | ||
申请公布号 | CN206099930U | 申请公布日期 | 2017.04.12 |
申请号 | CN201621096105.2 | 申请日期 | 2016.09.30 |
申请人 | 洛阳隆盛科技有限责任公司 | 发明人 | 王玲琴;李跃闯 |
分类号 | H03K17/296(2006.01)I | 主分类号 | H03K17/296(2006.01)I |
代理机构 | 洛阳市凯旋专利事务所 41112 | 代理人 | 韩晓静 |
主权项 | 一种DC‑DC模块上电时序控制电路,其特征是:其包括辅助输入电源、时序控制器、至少两个光耦、至少两个DC‑DC模块,辅助输入电源与时序控制器连接,时序控制器的TADJ引脚与GND引脚之间连接有电容,时序控制器的多个输出端口分别与至少两个DC‑DC模块的高电平有效控制输出端口一一对应连接,时序控制器的多个输出端口分别与上述光耦的正输入端一一对应连接,上述光耦的负输入端接地,至少两个光耦的正输出端分别与至少两个DC‑DC模块的低电平有效控制输出端口一一对应连接,上述光耦的负输出端接地。 | ||
地址 | 471000 河南省洛阳市西工区凯旋西路25号院 |