发明名称 |
一种16比特DDR SDRAM接口 |
摘要 |
一种16比特DDR SDRAM接口,所述的16比特DDR SDRAM接口上设置有一对差分DQS管脚,所述的一对差分DQS管脚可以是HDQS和HDQS#,此时芯片在低8比特的读写数据通路上增加延时控制;所述的一对差分DQS管脚也可以是LDQS和LDQS#,此时芯片在高8比特的读写数据通路上增加延时控制;本发明减少管脚数目意味产品成本更低或是产品可以提供更多功能而得以提高产品价值。减少管脚数目也减少了芯片面积和成本,减少工作电流和工作噪声,提高芯片性能。 |
申请公布号 |
CN103700394B |
申请公布日期 |
2016.09.28 |
申请号 |
CN201310650900.6 |
申请日期 |
2013.12.08 |
申请人 |
杭州国芯科技股份有限公司 |
发明人 |
梁骏;黄凤娇;王洪海;叶剑兵;叶丰 |
分类号 |
G11C11/4093(2006.01)I |
主分类号 |
G11C11/4093(2006.01)I |
代理机构 |
杭州君度专利代理事务所(特殊普通合伙) 33240 |
代理人 |
杜军 |
主权项 |
一种16比特DDR SDRAM接口,其特征在于所述的16比特DDR SDRAM接口上设置有一对差分DQS管脚,所述的一对差分DQS管脚为HDQS和HDQS#,此时芯片在低8比特的读写数据通路上增加延时控制;或者所述的一对差分DQS管脚为LDQS和LDQS#,此时芯片在高8比特的读写数据通路上增加延时控制;其中,所述HDQS表示正高数据选通,HDQS#表示负高数据选通,LDQS表示正低数据选通,LDQS#表示负低数据选通。 |
地址 |
310012 浙江省杭州市文三路90号东部软件园创新大厦A座5-6层 |