发明名称 Speicherverbindungsnetzarchitektur für einen Vektorprozessor
摘要 Prozessor, welcher Folgendes umfasst: ein Rechenfeld, welches Verarbeitungselemente aufweist, einen Speicher, welcher Speicherbänke aufweist, und eine Speicherverbindungsnetzarchitektur, die dazu dient, zumindest einige der Verarbeitungselemente mit zumindest einigen der Speicherbänke zu verbinden, wobei die Speicherverbindungsnetzarchitektur Folgendes aufweist: ein schalterbasiertes Verbindungsnetz und ein nicht-schalterbasiertes Verbindungsnetz, wobei der Prozessor dafür ausgelegt ist, einen ersten Datenoperanden über das schalterbasierte Verbindungsnetz zu zumindest einigen der Verarbeitungselemente synchron mit einem zweiten Datenoperanden über das nicht-schalterbasierte Verbindungsnetz zu zumindest einigen der Verarbeitungselemente zu laden, wobei der erste Datenoperand ein anderer Datenoperand für jedes Verarbeitungselement ist und der zweite Datenoperand derselbe Datenoperand für jedes Verarbeitungselement ist.
申请公布号 DE202013012281(U1) 申请公布日期 2016.01.18
申请号 DE20132012281U 申请日期 2013.10.16
申请人 ANALOG DEVICES GLOBAL 发明人
分类号 G06F9/30;G06F12/06 主分类号 G06F9/30
代理机构 代理人
主权项
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