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Eine zweikanalige, federtolerante Taktgeberanordnung enthält zwei Taktgeber (TG1, TG2), die je einen Oszillator (Q1, Q2) enthalten. Die Frequenz des Oszillators des einen Taktgebers (TG1) ist niedriger als die des anderen, synchronisierten Taktgebers (TG2). Dieser vergleicht die Phasendifferenz zwischen seinem Ausgangssignal und dem des anderen. Überschreitet die Phasendifferenz einen vorgegebenen Betrag, wird ein Impuls aus dem Ausgangssignal des Oszillators (Q2) ausgeblendet. Die Erfindung wird angewandt bei redundante Prozeßsteuer- und -leitsystemen. <IMAGE>
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