发明名称 一种可变速率SC-LDPC码的设计方法
摘要 本发明公开了一种可变速率SC-LDPC码的设计方法,包括步骤:一、选取C条耦合链准备进行并行连接;二、定义参数a=min{K′<sub>1</sub>,K′<sub>2</sub>,…,K′<sub>C</sub>},b=min{J′<sub>1</sub>,J′<sub>2</sub>,…,J′<sub>C</sub>},L=min{L<sub>1</sub>,L<sub>2</sub>,…,L<sub>C</sub>};三、对各条耦合链的1~L个位置,随机选择a个变量节点和b个校验节点;四、针对第j条耦合链,在第i个位置处,将所选择的a个变量节点所连接的原本连接在该位置上的b个校验节点上的边,连接到第z条耦合链的第i个位置上所选择的b个校验节点上,遍历i从1到L,j从1到C。本发明方法步骤简单,实现方便,得到的SC-LDPC码具有可变码率,不会改变变量节点和校验节点的度分布,设计得到的SC-LDPC码的译码性能优异。
申请公布号 CN104852747A 申请公布日期 2015.08.19
申请号 CN201510282647.2 申请日期 2015.05.28
申请人 西安电子科技大学 发明人 李颖;刘洋;郭旭东;孙岳
分类号 H03M13/11(2006.01)I 主分类号 H03M13/11(2006.01)I
代理机构 西安创知专利事务所 61213 代理人 景丽娜
主权项 一种可变速率SC‑LDPC码的设计方法,其特征在于该方法包括以下步骤:步骤一、选取相互独立且码率不同的C条耦合链准备进行并行连接,其中,第j条耦合链表示为C(J<sub>j</sub>,K<sub>j</sub>,L<sub>j</sub>),j∈[1,C],J<sub>j</sub>为第j条耦合链变量节点的度,K<sub>j</sub>为第j条耦合链校验节点的度,L<sub>j</sub>为第j条耦合链的耦合长度,每一条耦合链共有L<sub>j</sub>个位置;步骤二、定义参数a=min{K<sub>1</sub>',K<sub>2</sub>',…,K<sub>C</sub>'},定义参数b=min{J<sub>1</sub>',J<sub>2</sub>',…,J<sub>C</sub>'},定义参数L=min{L<sub>1</sub>,L<sub>2</sub>,…,L<sub>C</sub>},其中,K<sub>j</sub>'为第j条耦合链每个位置上的变量节点数目且K<sub>j</sub>'=K<sub>j</sub>/w<sub>j</sub>,J<sub>j</sub>'为第j条耦合链每个位置上的校验节点数目且J<sub>j</sub>'=J<sub>j</sub>/w<sub>j</sub>,L<sub>j</sub>为第j条耦合链的耦合长度,w<sub>j</sub>为J<sub>j</sub>和K<sub>j</sub>的最大公约数,即w<sub>j</sub>=gcd(J<sub>j</sub>,K<sub>j</sub>);步骤三、对各条耦合链的1~L个位置,随机选择a个变量节点和b个校验节点;步骤四、针对第j条耦合链,在第i个位置处,将所选择的a个变量节点所连接的原本连接在该位置上的b个校验节点上的边,连接到第z条耦合链的第i个位置上所选择的b个校验节点上,遍历i从1到L,j从1到C,并行连接得到SC‑LDPC码;其中,z=(jmodC)+1。
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