| 摘要 |
본 발명에 따른 디지털 신호처리 프로세서는 기생 커패시터에 데이터를 저장하는 복수의 메모리 셀을 포함하는 DRAM 및 미리 설정된 디지털 신호처리 알고리즘에 기초하여 상기 DRAM에 대하여 데이터 기록, 독출 또는 갱신 동작을 수행하는 코어 로직을 포함하되, 상기 코어 로직은 상기 DRAM의 메모리 셀에 대하여 입력 데이터를 기록한 후, 리텐션 시간의 경과 전에 기록된 상기 입력 데이터를 독출하여 외부로 출력하거나, 상기 DRAM의 다른 메모리 셀에 저장한다. |
