发明名称 |
叠置集成电路器件的晶体管的技术和构造 |
摘要 |
本公开内容的实施例提供了用于叠置存储器器件的晶体管的技术和构造。在一个实施例中,装置包括半导体衬底、形成在半导体衬底上的多个鳍状结构,其中多个鳍状结构中的个体鳍状结构包括设置在半导体衬底上的第一隔离层、设置在第一隔离层上的第一沟道层、设置在第一沟道层上的第二隔离层和栅极端子,所述栅极端子与第一沟道层电容性耦合以控制流经第一晶体管的第一沟道层的电流的流动并与第二沟道层电容性耦合以控制流经第二晶体管的第二沟道层的电流的流动。可以描述和/或要求保护其它实施例。 |
申请公布号 |
CN104170091A |
申请公布日期 |
2014.11.26 |
申请号 |
CN201180075597.0 |
申请日期 |
2011.12.28 |
申请人 |
英特尔公司 |
发明人 |
R·皮拉里塞泰;C·C·郭;H·W·田;G·杜威;W·拉赫马迪;V·H·勒;M·拉多萨夫列维奇;J·T·卡瓦列罗斯;N·慕克吉 |
分类号 |
H01L29/78(2006.01)I;H01L21/336(2006.01)I |
主分类号 |
H01L29/78(2006.01)I |
代理机构 |
永新专利商标代理有限公司 72002 |
代理人 |
王英;陈松涛 |
主权项 |
一种装置,包括:半导体衬底;形成在所述半导体衬底上的多个鳍状结构,其中,所述多个鳍状结构中的个体鳍状结构包括:设置在所述半导体衬底上的第一隔离层,设置在所述第一隔离层上的第一沟道层,设置在所述第一沟道层上的第二隔离层,和设置在所述第二隔离层上的第二沟道层;以及栅极端子,所述栅极端子与所述第一沟道层电容性耦合以控制流经第一晶体管的所述第一沟道层的电流的流动,并且与所述第二沟道层电容性耦合以控制流经第二晶体管的所述第二沟道层的电流的流动。 |
地址 |
美国加利福尼亚 |