发明名称 阵列基板行驱动电路
摘要 本发明提供一种阵列基板行驱动电路,包括级联的多级阵列基板行驱动单元,其中,该阵列基板行驱动电路的第n级阵列基板行驱动单元具有第n-1级信号第一输入端(21)、第n-1级信号第二输入端(22)、第n+1级信号输入端(23)、时钟信号第一输入端(24)、第一低电平输入端(25)、第二低电平输入端(26)、第一输出端(27)及第二输出端(28);该第n级阵列基板行驱动单元还包括:上拉控制单元(42);上拉单元(44);第一下拉维持单元(46);第二下拉维持单元(47);下拉单元(48)。本发明阵列基板行驱动电路可解决现有阵列基板行驱动电路中引入两个低电平信号引起的阵列基板行驱动电路功能性不良和电路操作寿命不长的问题,提高显示画面的质量。
申请公布号 CN103680453A 申请公布日期 2014.03.26
申请号 CN201310712607.8 申请日期 2013.12.20
申请人 深圳市华星光电技术有限公司 发明人 戴超;肖军城
分类号 G09G3/36(2006.01)I 主分类号 G09G3/36(2006.01)I
代理机构 深圳市德力知识产权代理事务所 44265 代理人 林才桂
主权项 一种阵列基板行驱动电路,其特征在于,包括级联的多级阵列基板行驱动单元,其中:对于位于阵列基板行驱动电路的第二级至倒数第二级的任一第n级阵列基板行驱动单元,所述第n级阵列基板行驱动单元具有第n‑1级信号第一输入端(21)、第n‑1级信号第二输入端(22)、第n+1级信号输入端(23)、第一输出端(27)及第二输出端(28),其中,所述第n级阵列基板行驱动单元的第一输出端(27)用于驱动阵列基板的有源区;所述第n级阵列基板行驱动单元的第n‑1级信号第一输入端(21)、第n‑1级信号第二输入端(22)及第n+1级信号输入端(23)分别电性连接至第n‑1级阵列基板行驱动单元的第一输出端(27)、第二输出端(28)及第n+1级阵列基板行驱动单元的第一输出端(27),所述第n级阵列基板行驱动单元的第一输出端(27)电性连接至第n+1级阵列基板行驱动单元的第n‑1级信号第一输入端(21)及第n‑1级阵列基板行驱动单元的第n+1级信号输入端(23),所述第n级阵列基板行驱动单元的第二输出端(28)电性连接至第n+1级阵列基板行驱动单元的第n‑1级信号第二输入端(22);对于位于阵列基板行驱动电路的第一级的第n级阵列基板行驱动单元,所述第n级阵列基板行驱动单元具有第n‑1级信号第一输入端(21)、第n‑1级信号第二输入端(22)、第n+1级信号输入端(23)、第一输出端(27)及第二输出端(28),其中,所述第n级阵列基板行驱动单元的第一输出端(27)用于驱动阵列基板的有源区;所述第n级阵列基板行驱动单元的第n‑1级信号第一输入端(21)和第n‑1级信号第二输入端(22)均用于输入一脉冲激活信号,所述第n+1级信号输入端(23)电性连接第n+1级阵列基板行驱动单元的第一输出端(27),所述第n级阵列基板行驱动单元的第一输出端(27)及第二输出端(28)分别电性连接至第n+1级阵列基板行驱动单元的第n‑1级信号第一输入端(21)及第n‑1级信号第二输入端(22);对于位于阵列基板行驱动电路的倒数第一级的第n级阵列基板行驱动单元,所述第n级阵列基板行驱动单元具有第n‑1级信号第一输入端(21)、第n‑1级信号第二输入端(22)、第n+1级信号输入端(23)、第一输出端(27)及第二输出端(28);所述第n级阵列基板行驱动单元的第n‑1级信号第一输入端(21) 及第二输入端(22)分别电性连接至第n‑1级阵列基板行驱动单元的第一输出端(27)及第二输出端(28),所述第n级阵列基板行驱动单元的第n+1级信号输入端(23)用于输入一脉冲激活信号,所述第n级阵列基板行驱动单元的第一输出端(27)电性连接至第n‑1级阵列基板行驱动单元的第n+1级信号输入端(23)且其第二输出端(28)设置为悬空;对于位于阵列基板行驱动电路的第一至倒数第一级的任一第n级阵列基板行驱动单元,所述第n级阵列基板行驱动单元还具有时钟信号第一输入端(24)、第一低电平输入端(25)、第二低电平输入端(26),所述第一低电平输入端(25)用于输入第一低电平,所述第二低电平输入端(26)用于输入第二低电平,且所述第二低电平小于第一低电平;对于位于阵列基板行驱动电路的第一至倒数第一级的任一第n级阵列基板行驱动单元,所述第n级阵列基板行驱动单元还包括:上拉控制单元(42),与第n‑1级信号第一输入端(21)及第n‑1级信号第二输入端(22)电性连接;上拉单元(44),分别与上拉控制单元(42)、时钟信号第一输入端(24)、第一输出端(27)及第二输出端(28)电性连接;第一下拉维持单元(46),分别与第一低电平输入端(25)、第二低电平输入端(26)、上拉控制单元(42)及上拉单元(44)电性连接;第二下拉维持单元(47),分别与第一低电平输入端(25)、第二低电平输入端(26)、第一下拉维持单元(46)、上拉控制单元(42)及上拉单元(44)电性连接;下拉单元(48),分别与第n+1级信号输入端(23)、第一低电平输入端(25)、上拉控制单元(42)、上拉单元(44)、第一下拉维持单元(46)、第二下拉维持单元(47)及第一输出端(27)电性连接。
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