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Die Erfindung betrifft ein Verfahren (200) zum Feststellen zumindest eines Fehlers (125, 126, 127) in Verbindungsleitungen (120) zwischen einer Mehrzahl von elektronischen Anschlusseinheiten (117a–c) und einer Mehrzahl von voneinander unabhängigen peripheren Einheiten (130), wobei die Anschlusseinheit (117a–c) durch einen flüchtig in eine Steuereinheit (115) einprogrammierten Algorithmus gesteuert werden und wobei die Verbindungleitungen (120) zwischen den peripheren Einheiten (130a–c) und der Anschlusseinheiten (117) je mittels zumindest einer Zweidrahtleitung ausgeführt sind. Das Verfahren (200) umfasst einen Schritt des Ausgebens (210) eines Startsignals von der Steuereinheit (115) an eine erste (130a) der Anschlusseinheiten (117a), um das Feststellen des Fehlers (125) zu starten. Ferner umfasst das Verfahren (200) einen Schritt des Anlegens (220) eines Testsignals an eine Schnittstelle (140a) einer ersten der Anschlusseinheiten (117a), wobei das Anlegen des Testsignals durch einen nicht-flüchtig in der ersten Anschlusseinheit (117a) einprogrammierten ersten Algorithmus (160a) überwacht und/oder gesteuert wird. Auch umfasst das Verfahren (200) einen Schritt des Erfassens (230) eines Überkoppelns des Testsignals an eine Schnittstelle (140b) einer zweiten Anschlusseinheit (117b) und Ablegen eines das Überkoppeln repräsentierenden Fehlerwertes in einem ersten Register (170b), wobei das Erfassen und Ablegen des Fehlerwertes durch einen nicht-flüchtig in der zweiten Anschlusseinheit (117b) einprogrammierten zweiten Algorithmus (160b) überwacht und/oder gesteuert wird. Schließlich umfasst das Verfahren (200) einen Schritt des Auslesens (240) des zumindest einen Fehlerwertes durch die Steuereinheit (110) zumindest aus dem ersten Register (170b), um den Fehler in den Verbindungsleitungen (120) zwischen der ersten Anschlusseinheit (117a) und der Mehrzahl von peripheren Einheiten (130) festzustellen. |
