发明名称 |
记忆体控制电路、延迟量设定装置、延迟量设定方法以及电脑程式产品 |
摘要 |
一种可改变由一信号输入至该信号输出时之延迟量之可变延迟电路,其具有延迟该信号达第一延迟量之一第一延迟区段;延迟该信号达大于该第一延迟量之一第二延迟量之一第二延迟区段;及选择一信号路径之一延迟量选择器,此处当该延迟量超过可由该第一延迟量区段延迟之最大延迟量时,该延迟量为第一延迟量与第二延迟量之和。由单一信号输入至当该信号输出之延迟量可设定于一宽广范围,同时抑制电路的规模。 |
申请公布号 |
TWI389136 |
申请公布日期 |
2013.03.11 |
申请号 |
TW097132372 |
申请日期 |
2008.08.25 |
申请人 |
富士通股份有限公司 日本 |
发明人 |
山学 |
分类号 |
G11C7/10;G11C11/4093 |
主分类号 |
G11C7/10 |
代理机构 |
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代理人 |
恽轶群 台北市松山区南京东路3段248号7楼;陈文郎 台北市松山区南京东路3段248号7楼 |
主权项 |
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地址 |
日本 |