发明名称 扫描成像导引头光机扫描组件数字化细分电路
摘要 本发明属于红外空空导弹导引头信息处理技术,涉及对扫描成像导引头光机扫描组件细分电路的改进。扫描成像导引头光机扫描组件数字化细分电路,其特征在于,它由两路结构相同的信号调理电路、一个频率检测电路[4]、一个相位检测电路[5]和一个脉冲生成电路[6]组成;信号调理电路由隔直电容C、AGC放大器[1]、A/D转换器[2]、脉冲变换器[3]组成;频率检测电路[4]由计数器[8]和高速时钟[9]组成;相位检测电路[5]由一个D触发器[10]组成;脉冲生成电路[6]由除法器[11]、分频器[12]、时钟延时[13]、非门[14]、第一选通开关[15]、第二选通开关[16]组成。本发明信号处理精度高,抗干扰能力强;电路简单,体积小,可靠性高;降低了系统调试难度,提高了调试效率。<pb pnum="1" />
申请公布号 CN106342193B 申请公布日期 2012.10.03
申请号 CN200810076271.X 申请日期 2008.08.07
申请人 中国空空导弹研究院 发明人 徐佩;孟卫华;魏新武;陈晓曾;孟庆超
分类号 G01J5/00(2006.01)I;F41G7/22(2006.01)I 主分类号 G01J5/00(2006.01)I
代理机构 中国航空专利中心 11008 代理人 梁瑞林
主权项 扫描成像导引头光机扫描组件数字化细分电路,其特征在于,它由两路结构相同的信号调理电路、一个频率检测电路[4]、一个相位检测电路[5]和一个脉冲生成电路[6]组成;(1)信号调理电路由隔直电容C、AGC放大器[1]、A/D转换器[2]、频率变换器[3]组成;隔直电容C的一端为信号调理电路的输入端,隔直电容C的另一端与AGC放大器[1]的输入端连接,AGC放大器[1]的输出端与A/D转换器[2]的输入端连接,A/D转换器[2]的输出端与频率变换器[3]的输入端连接,频率变换器[3]的输出端为信号调理电路的输出端;扫描成像导引头光机扫描组件输出的正交解码信号中的第一路信号与第一路信号调理电路[7a]的输入端Ina连接,扫描成像导引头光机扫描组件输出的正交解码信号中的第二路信号与第二路信号调理电路[7b]的输入端Inb连接;第一路信号调理电路[7a]和第二路信号调理电路[7b]的AGC放大器[1]分别将两路信号放大成两路幅值相同的模拟信号;第一路信号调理电路[7a]和第二路信号调理电路[7b]的频率变换器[3]设定有相同的比较阈值,经频率变换器[3]处理后,第一路信号调理电路[7a]输出占空比为50%的方波信号Outa,第二路信号调理电路[7b]输出占空比为50%的方波信号Outb;(2)频率检测电路[4]由计数器[8]和高速时钟[9]组成;第一路信号调理电路[7a]输出的方波信号Outa输入计数器[8]的输入端,计数器[8]的输出端为频率检测电路[4]的输出端COU,该输出端COU输出计数值,高速时钟[9]的输出端与计数器[8]的时钟信号输入端连接,高速时钟[9]的频率大于等于第一路信号调理电路[7a]输出的方波信号频率的100倍;(3)相位检测电路[5]由一个D触发器[10]组成;第一路信号调理电路[7a]的输出端与D触发器[10]的时钟输入端连接,第二路信号调理电路[7b]的输出端与D触发器[10]的触发输入端连接,D触发器[10]的输出端为相位检测电路[5]的输出端LG;通过在信号Outa的上升沿检测信号Outb的状态,在相位检测电路[5]的输出端输出一个信号,根据输出端LG输出信号的逻辑状态判断出两路解码信号的相位关系;(4)脉冲生成电路[6]由除法器[11]、分频器[12]、时钟延时[13]、非门[14]、第一选通开关[15]、第二选通开关[16]组成;频率检测电路<pb pnum="1" />[4]的输出端COU与除法器[11]的输入端连接,除法器[11]的输出端与分频器[12]的输入端连接,高速时钟[9]的输出端分别与分频器[12]和时钟延时[13]的时钟输入端连接,分频器[12]的输出端PA分别与时钟延时[13]的输入端和第一选通开关[15]的第一输入端、第二选通开关[16]的第一输入端连接,时钟延时[13]的输出端PB与第一选通开关[15]的第二输入端和第二选通开关[16]的第二输入端连接,相位检测电路[5]的输出端LG与非门[14]的输入端连接,非门[14]的输出端与第一选通开关[15]的选通控制端连接,相位检测电路[5]的输出端LG还与第二选通开关[16]的选通控制端连接,第一选通开关[15]的输出端POA为扫描成像导引头光机扫描组件数字化细分电路的第一输出端,第二选通开关[16]的输出端POB为扫描成像导引头光机扫描组件数字化细分电路的第二输出端;计数器[8]的输出计数值输入到除法器[11],除法器[11]内部除以设定的细分倍数得到除法器[11]输出计数值,在分频器[12]内根据除法器[11]输出计数值对高速时钟[9]进行分频;时钟延时[13]将分频器[12]输出端PA的脉冲信号延时1/4周期;当两路解码信号第一路信号相位超前时,输出端LG控制输出端POA选通PA,输出端POB选通PB,输出端POA相位超前输出端POB1/4周期,当两路解码信号第一路信号相位滞后时,输出端LG控制输出端POA选通PB,输出端POB选通PA,输出端POA相位滞后输出端POB1/4周期。<pb pnum="2" />
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