发明名称 一种伪随机数生成电路及伪随机数产生方法
摘要 本发明公开了一种伪随机数生成电路及伪随机数产生方法,其伪随机数生成电路包括分别由移位寄存器和异或模块构成的多路移位反馈电路;第一路移位反馈电路中的第一移位寄存器的输入端与源寄存器Rm的输出端连接,第一异或模块的第一、第二输入端分别与源寄存器Rm和源寄存器Rn的输出端连接,其输出端接入第一移位寄存器;第二-k路移位反馈电路中的移位寄存器和异或模块的第一输入端依次与其前一路移位反馈电路中的移位寄存器输出端连接,第二-k路移位反馈电路中异或模块的第二输入端分别与源寄存器Rn的输出端并联连接。一直生成所需的伪随机数,可以满足数字处理器运算部件所需伪随机数的要求。
申请公布号 CN102707923A 申请公布日期 2012.10.03
申请号 CN201210118947.3 申请日期 2012.04.21
申请人 中国电子科技集团公司第三十八研究所 发明人 马强;郭二辉;宋何娟;钟小艳
分类号 G06F7/58(2006.01)I 主分类号 G06F7/58(2006.01)I
代理机构 合肥金安专利事务所 34114 代理人 金惠贞
主权项 一种伪随机数生成电路,其特征在于:包括分别由移位寄存器和异或模块构成的多路移位反馈电路;第一路移位反馈电路中的第一移位寄存器的输入端与源寄存器Rm的输出端连接,第一异或模块的第一、第二输入端分别与源寄存器Rm和源寄存器Rn的输出端连接,其输出端接入第一移位寄存器;第二‑k路移位反馈电路中的移位寄存器和异或模块的第一输入端依次与其前一路移位反馈电路中的移位寄存器输出端连接,第二‑k路移位反馈电路中异或模块的第二输入端分别与源寄存器Rn的输出端并联连接。
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