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Dispositivo informático (50) que comprende: una memoria de acceso aleatorio; una memoria de sólo lectura; y una unidad de procesamiento central interconectada con dicha memoria de acceso aleatorio y dicha memoria de sólo lectura mediante un bus; estando configurada dicha unidad de procesamiento central para ejecutar una pluralidad de instrucciones de programación (70) que representan una pluralidad de objetos de software, comprendiendo dichos objetos de software una cola de lectura (74) para almacenar paquetes no procesados; incluyendo además dichos objetos de software una cola sin bloqueo (86) y un subproceso de lector (82) para leer cada uno de dichos paquetes no procesados de dicha cola de lectura a dicha cola sin bloqueo si dicha cola sin bloqueo (86) no está llena; incluyendo además dichos objetos de software una pluralidad de subprocesos de procesador (94), cada subproceso de procesador para realizar una operación en al menos uno de dichos paquetes no procesados en dicha cola sin bloqueo (86); incluyendo además dichos objetos de software una cola de escritura (78) y un subproceso de escritor (84) para escribir paquetes que se han procesado por dicha pluralidad de subprocesos de procesador (94) de dicha cola sin bloqueo (86) a dicha cola de escritura (78) .
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