发明名称 |
全数位锁相回路及其时间至数位转换器模组、循环式时间至数位转换器模组 |
摘要 |
本发明涉及错误防止方法、时间至数位转换器模组、循环式时间至数位转换器模组、全数位锁相回路及校准方法。错误防止方法用于全数位锁相回路之时间至数位转换解码器。错误防止方法包含由时间至数位转换解码器取得资料讯号;由时间至数位转换解码器取得循环讯号;对资料讯号之第一预定位元与循环讯号之第二预定位元实施互斥或逻辑运算,以产生误差保护码;及藉由将误差保护码加入于循环讯号并将循环讯号位移第三预定数量之位元,来使用误差保护码来修正循环讯号中的误差。 |
申请公布号 |
TWI363499 |
申请公布日期 |
2012.05.01 |
申请号 |
TW097139712 |
申请日期 |
2008.10.16 |
申请人 |
联发科技股份有限公司 新竹市新竹科学工业园区笃行一路1号 |
发明人 |
张湘辉;谢秉谕;詹景宏 |
分类号 |
H03M1/10;H03M1/50;H03L7/08 |
主分类号 |
H03M1/10 |
代理机构 |
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代理人 |
戴俊彦 新北市永和区福和路389号6楼之3;吴丰任 新北市永和区福和路389号6楼之3 |
主权项 |
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地址 |
新竹市新竹科学工业园区笃行一路1号 |