Input/output buffer with silicide layer and method of manufacturing,申请号EP20000121872-传众专利搜索

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法人/股东/高管

发明名称	Input/output buffer with silicide layer and method of manufacturing
摘要
申请公布号	EP1091397(B1)	申请公布日期	2012.03.21
申请号	EP20000121872	申请日期	2000.10.06
申请人	RENESAS ELECTRONICS CORPORATION	发明人	KATO, OSAMU;HIRATA, MORIHISA;MORISHITA, YASUYUKI
分类号	H01L21/335;H01L27/04;H01L21/28;H01L21/822;H01L21/8238;H01L27/02;H01L27/06;H01L27/092;H01L29/41;H01L29/43;H01L29/78	主分类号	H01L21/335
代理机构		代理人
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