发明名称 一种浮点数乘加器融合处理装置及方法
摘要 本发明提供一种浮点数乘加器融合处理装置及方法,其中,该方法包括:把浮点复数乘数和被乘数的实部和虚部分解输入到浮点乘法模块M0和M1,先进行浮点乘法运算,该输出结果用进位位和部分和表示乘积,并且把该乘积输入到浮点加法模块A2进行浮点加法运算,该输出结果用进位位和部分和表示相加运算,再把表示相加运算的输出结果同时输入到浮点加法模块A0和A1,再把外部输入的加数也输入到浮点加法模块A0和A1,进行浮点加法运算,最后输出运算结果。本发明能够更好地应用于傅里叶变换的蝶形运算,能够简化运算步骤,在硬件实现上容易实现节省资源,用较少资源解决了浮点复数乘加的运算。
申请公布号 CN102339217A 申请公布日期 2012.02.01
申请号 CN201010237457.6 申请日期 2010.07.27
申请人 中兴通讯股份有限公司 发明人 田丙辛
分类号 G06F7/57(2006.01)I 主分类号 G06F7/57(2006.01)I
代理机构 工业和信息化部电子专利中心 11010 代理人 梁军
主权项 一种浮点数乘加器融合处理方法,其特征在于,把浮点复数乘数和被乘数的实部和虚部分解输入到浮点乘法模块M0和M1,先进行浮点乘法运算,该输出结果用进位位和部分和表示乘积,并且把该乘积输入到浮点加法模块A2进行浮点加法运算,该输出结果用进位位和部分和表示相加运算,再把该表示相加运算的输出结果同时输入到浮点加法模块A0和A1,再把外部输入的加数也输入到浮点加法模块A0和A1,进行浮点加法运算,最后输出运算结果。
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