发明名称 | 一种对FPGA内部嵌入式多位存储器故障的测试方法 | ||
摘要 | 一种对FPGA内部嵌入式多位存储器故障的测试方法,它有六大步骤:一、基于March C-算法,首先增加测试图样数2×(1+log2n);二、将2×(1+log2n)种测试图样代入March C-算法的6个March单元,得到位宽为n bit的以存储单元为基准的存储器March C-测试算法;三、利用Verilog硬件描述语言在FPGA内部构建BIST结构;四、在BIST平台下,由控制单元控制不同状态下输入被测存储器的测试图形、状态控制器所在状态以及内部响应分析器的启动与停止,由测试图形生成器生成针对存储器不同故障模型所需的March元素测试图形序列;五、根据以上生成的测试图形对存储器进行测试;六、观察测试波形,确定存储器故障类型。本发明方法简单,实现容易,在FPGA内部嵌入式多位存储器测试领域有很广阔的应用前景。 | ||
申请公布号 | CN102157205A | 申请公布日期 | 2011.08.17 |
申请号 | CN201110119650.4 | 申请日期 | 2011.05.10 |
申请人 | 北京航空航天大学 | 发明人 | 高成;刘孝章;黄姣英 |
分类号 | G11C29/12(2006.01)I | 主分类号 | G11C29/12(2006.01)I |
代理机构 | 北京慧泉知识产权代理有限公司 11232 | 代理人 | 王顺荣;唐爱华 |
主权项 | 1.一种对FPGA内部嵌入式多位存储器故障的测试方法,其特征在于:该方法具体步骤如下:步骤一:基于March C-算法,首先增加测试图样;对于FPGA内部嵌入式n位存储器来说,其测试图样数为2×(1+log<sub>2</sub>n),该测试图样如下所示:<tables num="0001"><table><tgroup cols="4"><colspec colname="c001" colwidth="16%" /><colspec colname="c002" colwidth="32%" /><colspec colname="c003" colwidth="17%" /><colspec colname="c004" colwidth="35%" /><tbody><row><entry morerows="1"> Group0</entry><entry morerows="1"> 00000000…00000000</entry><entry morerows="1"> Group1</entry><entry morerows="1"> 11111111…11111111</entry></row><row><entry morerows="1"> Group2</entry><entry morerows="1"> 01010101…01010101</entry><entry morerows="1"> Group3</entry><entry morerows="1"> 10101010…10101010</entry></row><row><entry morerows="1"> Group4</entry><entry morerows="1"> 00110011…00110011</entry><entry morerows="1"> Group5</entry><entry morerows="1"> 11001100…11001100</entry></row><row><entry morerows="1"> Group6</entry><entry morerows="1"> 00001111…00001111</entry><entry morerows="1"> Group7</entry><entry morerows="1"> 11110000…11110000</entry></row><row><entry morerows="1"> Group8</entry><entry morerows="1"> 00000000…11111111</entry><entry morerows="1"> Group9</entry><entry morerows="1"> 11111111…00000000</entry></row><row><entry morerows="1"> ...</entry><entry morerows="1"> ...</entry><entry morerows="1"> ...</entry><entry morerows="1"> ...</entry></row></tbody></tgroup></table></tables>步骤二:将2×(1+log<sub>2</sub>n)种测试图样代入March C-算法的6个March元素中——即M0,M1,M2,M3,M4和M5六个March单元,得到位宽为n bit的以存储单元为基准的存储器March C-测试算法:<img file="FDA0000060240120000011.GIF" wi="1824" he="1232" />步骤三:利用Verilog硬件描述语言在FPGA内部构建BIST结构,以实现对其内部嵌入式多位存储器故障的测试;步骤四:在BIST平台下,由控制单元控制不同状态下输入被测存储器的测试图形、状态控制器所在状态以及内部响应分析器的启动与停止,由测试图形生成器生成针对存储器不同故障模型所需的March元素测试图形序列;步骤五:根据以上生成的测试图形对存储器进行测试;下面给出存储器BIST系统Verilog代码片段,该代码片段实现:对嵌入式存储器的全部存储单元,按地址升序先读取测试图样m0后,写入测试图样m1:<img file="FDA0000060240120000021.GIF" wi="2008" he="2173" /><img file="FDA0000060240120000031.GIF" wi="2006" he="869" />步骤六:观察测试波形,确定存储器故障类型。 | ||
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