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发明名称 Analog/digital partitioning of circuit designs for simulation
摘要
申请公布号 US7797659(B2) 申请公布日期 2010.09.14
申请号 US20070699881 申请日期 2007.01.29
申请人 CADENCE DESIGN SYSTEMS, INC. 发明人 CHETPUT CHANDRASHEKAR L.;KOLPEKWAR ABHIJEET;IYENGAR SRINIVASAN
分类号 G06F17/50 主分类号 G06F17/50
代理机构 代理人
主权项
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