发明名称 |
METHODS AND APPARATUS FOR TRANSFORMING SEQUENTIAL LOGIC DESIGNS INTO EQUIVALENT COMBINATIONAL LOGIC |
摘要 |
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申请公布号 |
EP1700132(B1) |
申请公布日期 |
2010.05.05 |
申请号 |
EP20040813440 |
申请日期 |
2004.12.08 |
申请人 |
CADENCE DESIGN SYSTEMS, INC. |
发明人 |
VANDLING, GILBERT, C. |
分类号 |
G06F11/263;G01R31/3183;G06F11/267 |
主分类号 |
G06F11/263 |
代理机构 |
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代理人 |
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主权项 |
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地址 |
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