| 发明名称 | 具备具有电荷累积层和控制栅极的存储单元的半导体装置及其数据写入方法 | ||
| 摘要 | 本发明涉及半导体装置及其数据写入方法。半导体装置具备非易失性半导体存储器(11)与控制器(12)。非易失性半导体存储器(11)，具有具备可以保持2比特以上的数据的多个存储单元的第1存储块(BLK1)和具备可以保持1比特的数据的多个存储单元的第2存储块(BLK2)。在第1存储块(BLK1)中，页按上述数据的每比特而分配，且每比特所需要的写入时间不同。控制器(12)，在写入数据的尾页相当于在第1存储块(BLK1)中所需要的时间为最长的比特的情况下，对非易失性半导体存储器(11)进行指示，以在第2存储块(BLK2)的任一页执行该数据的编程。 | ||
| 申请公布号 | CN101650970A | 申请公布日期 | 2010.02.17 |
| 申请号 | CN200910165394.5 | 申请日期 | 2009.08.11 |
| 申请人 | 株式会社东芝 | 发明人 | 辻秀贵 |
| 分类号 | G11C16/02(2006.01)I;G11C16/10(2006.01)I | 主分类号 | G11C16/02(2006.01)I |
| 代理机构 | 北京市中咨律师事务所 | 代理人 | 陈海红;刘瑞东 |
| 主权项 | 1.一种半导体装置，具备：非易失性半导体存储器(11)，其具有具备可以保持2比特以上的数据的多个存储单元的第1存储块(BLK1)和具备可以保持1比特的数据的多个存储单元的第2存储块(BLK2)，并可以对于上述第1、第2存储块(BLK1、BLK2)以作为多个上述存储单元的集合的页为单位编程数据，在上述第1存储块(BLK1)中，上述页按可以保持的上述数据的每比特分配，且每比特所需要的写入时间不同；和控制器(12)，其向上述非易失性半导体存储器(11)供给从主机设备(2)接收到的写入数据，并将向上述第1存储块(BLK1)或第2存储块(BLK2)的上述写入数据的编程，按上述每页指示给上述非易失性半导体存储器(11)，上述控制器(12)，在上述写入数据的尾页相当于上述写入所需要的时间为最长的比特的情况下，对于上述非易失性半导体存储器(11)在上述第2存储块(BLK2)的任一页执行关于该数据的编程。 | ||
| 地址 | 日本东京都 | ||