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发明名称 SUPERPIPELINED VLIW PROCESSOR ADDRESSING BYPASS-LOOP SPEED LIMITATION
摘要
申请公布号 EP1546868(B1) 申请公布日期 2008.11.19
申请号 EP20030756845 申请日期 2003.09.17
申请人 NXP B.V. 发明人 SLAVENBURG, GERRIT;VAN DE WAERDT, JAN-WILLEM
分类号 G06F9/38;G06F9/30 主分类号 G06F9/38
代理机构 代理人
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