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发明名称
堆叠之积体电路晶片组成件
摘要
积体电路晶片(12,14,16)之堆叠配置(10)系接合于导线架构件(62,64,66),两个并列的积体电路晶片(12,14)具有系接合于具有接触端子(38)之导线架构件(62,64,66)的底部接触垫块(46,48,50,56,58,60),该两个并列的积体电路晶片(12,14)具有系接合于一覆盖之积体电路晶片(16)的顶部接触垫块(52,54),一型面高度不大的(low profile)晶片组成件(10)被达成而没有使用导线或预成型,且其系相当适用于SO-8封装组件。
申请公布号
TW200731502
申请公布日期
2007.08.16
申请号
TW095137740
申请日期
2006.10.13
申请人
李特尔佛斯公司
发明人
嘉德 佛斯
分类号
H01L25/00(2006.01);H01L23/28(2006.01);H01L23/12(2006.01)
主分类号
H01L25/00(2006.01)
代理机构
代理人
林志刚
主权项
地址
美国
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