发明名称 单脉冲基片集成波导缝隙阵列天线
摘要 本发明公开了一种重量轻、损耗低、平面结构的集成和差相位比较网络的单脉冲基片集成波导缝隙阵列天线;包括:基片集成波导缝隙阵列天线本体及4个天线输入和或输出端口,还包括和差相位比较网络,和差相位比较网络包括和波速通道、水平差波速通道、对角面差波速通道及垂直方向差波速通道,该天线由于该基片集成波导(SIW)结构仅由单层介质板外加上、下两层金属敷层和两侧的金属化通孔构成,所以可以采用目前非常成熟的单层印刷电路板(PCB)生产工艺来生产,成本十分低廉;结构紧凑,易于集成,低损耗,加工难度低,易于大规模生产,器件上、下表面均有金属覆盖,抗干扰能力强。
申请公布号 CN1937316A 申请公布日期 2007.03.28
申请号 CN200610096845.0 申请日期 2006.10.20
申请人 东南大学 发明人 洪伟;刘冰
分类号 H01Q13/00(2006.01);H01Q13/10(2006.01);H01Q21/00(2006.01) 主分类号 H01Q13/00(2006.01)
代理机构 南京经纬专利商标代理有限公司 代理人 陆志斌
主权项 1、一种集成和差相位比较网络的单脉冲基片集成波导缝隙阵列天线,包括:基片集成波导缝隙阵列天线本体(1)及4个天线输入和或输出端口(Port1、Port2、Port3、Port4),其特征在于还包括和差相位比较网络,和差相位比较网络包括和波速通道(21)、水平差波速通道(22)、对角面差波速通道(23)及垂直方向差波速通道(24),该和差相位比较网络的和波速通道(21)、水平差波速通道(22)、对角面差波速通道(23)及垂直方向差波速通道(24)分别由2行或2行以上的金属化通孔构成,在和波速通道(21)及水平差波速通道(22)的一端与上述4个端口中的2个天线输入和或输出端口(Port1、Port2)之间设有90度三分贝第一定向耦合器(31)且90度三分贝第一定向耦合器(31)的4个端口分别与和波速通道(21)的一端、水平差波速通道(22)的一端及4个端口中的2个天线输入和或输出端口(Port1、Port2)连接,在对角面差波速通道(23)及垂直方向差波速通道(24)的一端与上述4个端口中的另2个天线输入和或输出端口(Port3、Port4)之间设有90度三分贝第二定向耦合器(32)且该90度三分贝第二定向耦合器(32)的4个端口分别与对角面差波速通道(23)的一端、垂直方向差波速通道(24)的一端及另2个天线输入和或输出端口(Port3、Port4)连接,在和波速通道(21)及对角面差波速通道(23)的另一端与基片集成波导缝隙阵列天线本体(1)的2个输出和或输入端口(Port6、Port7)之间设有90度三分贝第三定向耦合器(33)且该90度三分贝第三定向耦合器(33)的4个端口分别与和波速通道(21)的另一端、对角面差波速通道(23)的另一端及基片集成波导缝隙阵列天线本体(1)的2个输出和或输入端口(Port6、Port7)连接,在水平差波速通道(22)及垂直方向差波速通道(24)的另一端与基片集成波导缝隙阵列天线本体(1)的另2个输出和或输入端口(Port5、Port8)之间设有90度三分贝第四定向耦合器(34)且该90度三分贝第四定向耦合器(34)的4个端口分别与水平差波速通道(22)的另一端、垂直方向差波速通道(24)的另一端及基片集成波导缝隙阵列天线本体(1)的另2个输出和或输入端口(Port5、Port8)连接,上述90度三分贝定向耦合器由2个公边界的基片集成波导组成,在2个基片集成波导的公共边界上设有耦合窗(355),在和波速通道(21)的一端与90度三分贝第一定向耦合器(31)之间设有90°相位延迟线(41)且和波速通道(21)的一端通过90°相位延迟线(41)与90度三分贝第一定向耦合器(31)连接,在和波速通道(21)的另一端与90度三分贝第三定向耦合器(33)之间设有90°相位延迟线(42)且和波速通道(21)的另一端通过90°相位延迟线(42)与90度三分贝第三定向耦合器(33)连接,在90度三分贝第三定向耦合器(33)与基片集成波导缝隙阵列天线本体(1)的输出和或输入端口(Port6)之间设有90°相位延迟线(43)且90度三分贝第三定向耦合器(33)通过90°相位延迟线(43)与基片集成波导缝隙阵列天线本体(1)的输出和或输入端口(Port6)连接,在水平差波速通道(22)的另一端与90度三分贝第四定向耦合器(34)设有90°相位延迟线(44)且水平差波速通道(22)的另一端通过90°相位延迟线(44)与90度三分贝第四定向耦合器(34)连接,在90度三分贝第四定向耦合器(34)与集成波导缝隙阵列天线本体(1)的输出和或输入端口(Port5)之间设有90°相位延迟线(45)且90度三分贝第四定向耦合器(34)通过90°相位延迟线(45)与集成波导缝隙阵列天线本体(1)的输出和或输入端口(Port5)连接,在90度三分贝第二定向耦合器(32)与垂直方向差波速通道(24)的一端之间设有90°相位延迟线(46)且90度三分贝第二定向耦合器(32)通过90°相位延迟线(46)与垂直方向差波速通道(24)连接。
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