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发明名称
Delay-Insensitive Data Transfer Circuit Using Current-Mode Multiple-Valued Logic
摘要
申请公布号
KR100609368(B1)
申请公布日期
2006.08.08
申请号
KR20040011299
申请日期
2004.02.20
申请人
发明人
分类号
H04L12/02;H02M11/00
主分类号
H04L12/02
代理机构
代理人
主权项
地址
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