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发明名称 Verfahren zum Simulieren einer zu verifizierenden Schaltungseinheit und Verzögerungsschalenvorrichtung
摘要
申请公布号 DE10122252(B4) 申请公布日期 2006.05.04
申请号 DE20011022252 申请日期 2001.05.08
申请人 INFINEON TECHNOLOGIES AG 发明人 HENFTLING, RENATE;ECKER, WOLFGANG;ZINN, ANDREAS;BAUER, MATTHIAS;PILSL, MICHAEL;ZAMBALDI, MARTIN
分类号 G06F17/50;G01R31/3183 主分类号 G06F17/50
代理机构 代理人
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