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发明名称
Verfahren zur Erkennung und Kompensation von Bit-slip-Fehlern bei der seriellen Übertragung digitaler Daten sowie hierfür empfängerseitig verwendbare Schaltungsanordnung
摘要
申请公布号
DE10154252(B4)
申请公布日期
2005.12.01
申请号
DE2001154252
申请日期
2001.11.05
申请人
SIEMENS AG
发明人
WAHR, ALFONS
分类号
H04L1/00;(IPC1-7):H04L1/00
主分类号
H04L1/00
代理机构
代理人
主权项
地址
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