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发明名称 Delay locked loop capable of compensating the delay of internal clock signal according to the variation of output driver strength in semiconductor memory device
摘要
申请公布号 KR100518547(B1) 申请公布日期 2005.10.04
申请号 KR20020085867 申请日期 2002.12.28
申请人 发明人
分类号 G11C8/00;H03L7/081;(IPC1-7):G11C8/00 主分类号 G11C8/00
代理机构 代理人
主权项
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