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L'invention concerne les convertisseurs analogiques-numériques rapides à entrées différentielles et à structure parallèle, comprenant au moins un réseau de N résistances en série de valeur r et un réseau de N comparateurs. Pour minimiser l'influence des capacités parasites du réseau de résistances sur le temps de réponse du comparateur, on prévoit que le réseau de résistances en série reçoit une tension de référence (VH) et est parcouru pa r un courant fixe I0 et que le comparateur (COMPi) de rang i (i variant de 1 à N) comprend essentiellement un amplificateur différentiel double à quatre entrées ; deux entrées reçoivent une tension différentielle VS-VN à converti r, une troisième étant reliée à une résistance de rang i du réseau, et une quatrième entrée étant reliée à une résistance de rang N-i du réseau. L'amplificateur différentiel double fournit une tension représentant une différence de la forme (VS-VSN) - (N-2i)r.Io, et le comparateur bascule dans un sens ou dans l'autre selon le niveau de la tension VS-VSN et selon le ran g i du comparateur lorsque cette différence change de signe.
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