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发明名称
不同记忆体间之缓冲控制架构及方法
摘要
一种不同记忆体间之缓冲控制架构及方法,用来作为记忆体间资料传输时之缓冲控制。该不同记忆体间之缓冲控制架构包含有:微处理器,系用以处理记忆体汇流排资料的传输;第一记忆体,系连结于该微处理器;第二记忆体,系连结于该微处理器;藉此,第一记忆体与第二记忆可经由微处理器的控制而相互传输资料。
申请公布号
TW200517836
申请公布日期
2005.06.01
申请号
TW092132281
申请日期
2003.11.18
申请人
捷泰科技股份有限公司
发明人
朱立伟;江峥岷;蔡志诚
分类号
G06F13/00;G06F11/28
主分类号
G06F13/00
代理机构
代理人
谢宗颖;王云平
主权项
地址
新竹县竹东镇中兴路4段195号52馆328室
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