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发明名称
积体电路结构内介电阻障层之制造方法、内连结构与半导体装置及其制造方法
摘要
本发明系关于积体电路结构内介电阻障层之制造方法、内连结构与半导体装置及其制造方法,其中积体电路结构内介电阻障层之制造方法,包括下列步骤:形成一低介电常数介电层于一基板上,该低介电常数介电层具有至少一开口以露出一下层金属层;以及形成一第一碳化矽基阻障层,以覆盖该低介电常数介电层之露出表面。
申请公布号
TW200511493
申请公布日期
2005.03.16
申请号
TW093127264
申请日期
2004.09.09
申请人
台湾积体电路制造股份有限公司
发明人
刘埃森;章勋明
分类号
H01L21/76
主分类号
H01L21/76
代理机构
代理人
洪澄文;颜锦顺
主权项
地址
新竹市新竹科学工业园区力行六路8号
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