发明名称 |
Verfahren zum Verringern der Leistungsaufnahme in einem Computersystem mit Busmaster-Geräten |
摘要 |
A system memory accessed by a bus master controller is set as non-cacheable. A bus master status bit is not set for any bus master controller transfer cycles with the non-cacheable memory while the a system processor is in a low power state. |
申请公布号 |
DE10392351(T5) |
申请公布日期 |
2005.03.10 |
申请号 |
DE2003192351T |
申请日期 |
2003.02.25 |
申请人 |
INTEL CORPORATION, SANTA CLARA |
发明人 |
KARDACH, JAMES |
分类号 |
G06F1/32;G06F12/08;(IPC1-7):G06F1/32 |
主分类号 |
G06F1/32 |
代理机构 |
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代理人 |
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主权项 |
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地址 |
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