发明名称 |
INTEGRATED DATA CLOCK EXTRACTOR |
摘要 |
A circuit for generating a data clock signal from input timing informatio n. The circuit incorporates a cycle limit extractor in order to correct data error in the phase corrected output resulting from circuit counter rollover.
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申请公布号 |
CA2338320(C) |
申请公布日期 |
2004.05.11 |
申请号 |
CA20012338320 |
申请日期 |
2001.02.26 |
申请人 |
MITEL CORPORATION |
发明人 |
GRESHAM, PAUL ALAN |
分类号 |
H03L7/081;H03L7/085;H04L7/033;(IPC1-7):H04L7/027 |
主分类号 |
H03L7/081 |
代理机构 |
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代理人 |
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主权项 |
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地址 |
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