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发明名称
其内部产生读取内部资料之时序的半导体记忆装置
摘要
在既定数之各字元线设置具有复数虚拟单元之虚拟电路1a~1c。在选择对应之字元线时,使用该虚拟电路所含之复数虚拟单元驱动负载和正规位元线相同之虚拟位元线DBL。利用虚拟感测放大器DSA侦测该虚拟位元线DBL之电位后,产生感测启动信号SE。可正确的侦测感测时序,和阵列构造无关。
申请公布号
TW200403680
申请公布日期
2004.03.01
申请号
TW092118033
申请日期
2003.07.02
申请人
瑞萨科技股份有限公司;瑞萨电子元件设计股份有限公司
发明人
吉泽知晃;新居浩二;今冈进
分类号
G11C11/417;G11C11/419
主分类号
G11C11/417
代理机构
代理人
洪澄文
主权项
地址
日本
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