发明名称 宽带码分多址系统下行合成信道化装置
摘要 一种宽带码分多址系统下行合成信道化装置,包括:运算存储器,接收和保存已经过信道增益控制的所有信道的业务数据作为合成信道化运算的初始值,并缓存运算产生的中间结果用于迭代;运算控制表,根据系统给出的信道参数来确定当前工作周期内运算器应该选择的运算方式;运算器,完成对矩阵元素的几种基本运算,这些基本运算相互组合并经过迭代产生的效果就是完成信道化扩频和信道合成;地址控制表,控制运算存储器和结果存储器的读写,来选择参与运算的数据读取和运算结果的存储;结果存储器,用于缓存运算的最终结果用于输出。本发明从根本上解决了现有技术因为采用单信道信道化装置造成的系统资源闲置和规模庞大的问题。
申请公布号 CN1469564A 申请公布日期 2004.01.21
申请号 CN02136042.1 申请日期 2002.07.15
申请人 上海贝尔有限公司 发明人 刘斌;吴素芳;方新耀;李少颍;曹鹏志
分类号 H04J13/00;H04Q7/30 主分类号 H04J13/00
代理机构 上海专利商标事务所 代理人 章蔚强
主权项 1.一种宽带码分多址系统下行合成信道化装置,其特征在于,它包括运算存储器、运算控制表、结果存储器、地址控制表、以及分别与运算存储器、运算控制表和结果存储器相连的运算器,所述的地址控制表连接在运算存储器和结果存储器之间,其中:运算存储器,接收和保存已经过信道增益控制的所有信道的业务数据作为合成信道化运算的初始值,并缓存运算产生的中间结果用于迭代;运算控制表,根据系统给出的信道参数来确定当前工作周期内运算器应该选择的运算方式;运算器,完成对矩阵元素的几种基本运算,这些基本运算相互组合并经过迭代产生的效果就是完成信道化扩频和信道合成;地址控制表,控制运算存储器和结果存储器的读写,来选择参与运算的数据读取和运算结果的存储;结果存储器,用于缓存运算的最终结果用于输出。
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