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发明名称
用于积体电路之输入/输出特微链路
摘要
本发明系提出一种输入/输出特征暂存器,用于特征化一积体电路输入或输出。该暂存器包括:一正常资料输入、一特征资料输入、与一资料闩锁,其具有一闩锁控制输入、一闩锁资料输入与一闩锁资料输出。该正常资料输入与特征资料输入系与该闩锁资料输出而多工处理至闩锁资料输入。
申请公布号
TW200305727
申请公布日期
2003.11.01
申请号
TW092107362
申请日期
2003.04.01
申请人
LSI逻辑公司
发明人
彼得 柯革;布来恩 休纳
分类号
G01R31/28
主分类号
G01R31/28
代理机构
代理人
林镒珠
主权项
地址
美国
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