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Die vorliegende Erfindung ist eine Architektur für eine Nachreglerspannungsschaltung, welches ein Voraustriggersignal zum Triggern der Nachreglerrampe benutzt. Dieses Voraustriggersignal antizipiert den Beginn und/oder das Ende eines Leistungszyklus und kann benutzt werden, um alle sekundären Gleichrichterschalter mit optimalem Timing zu synchronisieren, um Querleitung und Gehäusediodenleitung zu minimieren. Die Architektur kann benutzt werden, um eine nicht festgelegte Zahl von Nachreglern aneinanderzureihen. Die vorliegende Erfindung bietet den Hilfsausgängen dieselbe Regulationsspanne, wie sie für den Hauptausgang möglich ist, selbst unter Leichtlastbedingungen. Statt den Beginn oder das Ende eines Leistungszyklus zu ermitteln, antizipiert die vorliegende Erfindung den Beginn und/oder das Ende des Leistungszyklus, indem die von der Feedbackschleife für den Hauptausgang generierte Pulsfolge benutzt wird. Dies erlaubt dem Schaltkreis, die Schalter auf den Beginn des Leistungszyklus vorzubereiten und vermeidet Probleme, die mit inhärenten Laufzeitverzögerungen im Schaltkreis auftreten. Durch das Voraustriggersignal können alle Schalter mit präzisem Timing getrieben werden.
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