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Die Erfindung betrifft eine Schaltungsanordnung zum Entladen midnestens eines Schaltungsknotens, die einen Eingang (10) und mindestens einen Ausgang (12), mindestens einen steuerbaren Widerstand (Q1-NMOS; Q1-NPN; Q1 (HV) (Darlington); Q1, Q2, Qn; Q1 (HV), Q2 (HV)), eine Kapazität (C1) und eine Diode (D1) aufweist, wobei ein erster Anschluss (14) der steuerbaren Strecke (16) des steuerbaren Widerstands mit dem Ausgang (12), ein zweiter Anschluss (18) der steuerbaren Strecke (16) des steuerbaren Widerstands mit dem Eingang (10), ein Anschluss der Kapazität (C1) und die Kathode der Diode (D1) mit dem Steueranschluss (20) des steuerbaren Widerstands und die Anode der Diode (D1) mit dem Eingang (10) verbunden sind. Die Schaltungsanordnung benötigt in einer integrierten Schaltung eine sehr geringe Fläche und ermöglicht ein sehr schnelles Entladen des Schaltungsknotens.
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