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Ein integrierter Speicher weist ein Speicherzellenfeld (1) mit Wortleitungen (WL1, WL2) und Bitleitungen (BL1, BL2) auf. Die Bitleitungen (BL1, BL2) sind zum Auslesen eines Datensignals jeweils über ein steuerbares Schaltmittel (T1, T2) mit einem Leseverstärker (SA) verbindbar. Weiterhin ist eine Steuerschaltung (S) enthalten mit einem Ausgang, der mit einem Steuereingang des jeweiligen Schaltmittels (T1, T2) verbunden ist, und mit einem Eingang, der mit einem Anschluß für ein Testmodussignal (TM) verbunden ist. Die Steuerschaltung (S) ist derart ausgebildet, daß innerhalb eines Zugriffszyklus das jeweilige Schaltmittel (T1, T2) infolge eines aktiven Zustands des Testmodussignals (TM) in einen nicht leitenden Zustand schaltbar ist. Bei dem integrierten Speicher ist das Leckverhalten einer Bitleitung beim Auslesen eines Datensignals messbar.
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