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发明名称 MEMORY ADDRESS DECODING CIRCUIT FOR A SIMULTANEOUS OPERATION FLASH MEMORY DEVICE WITH A FLEXIBLE BANK PARTITION ARCHITECTURE
摘要
申请公布号 KR20010100840(A) 申请公布日期 2001.11.14
申请号 KR1020017003761 申请日期 2001.03.23
申请人 发明人
分类号 G11C16/08 主分类号 G11C16/08
代理机构 代理人
主权项
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