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发明名称
System clock synchronisation using phased-lock loop
摘要
申请公布号
GB0100094(D0)
申请公布日期
2001.02.14
申请号
GB20010000094
申请日期
2001.01.03
申请人
VTECH COMMUNICATIONS LTD
发明人
分类号
H03L7/085;H03L7/091;H03L7/181;H04B7/26;H04J3/06;H04L7/033;H04M1/725
主分类号
H03L7/085
代理机构
代理人
主权项
地址
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