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Die Erfindung betrifft einen Halbleiterspeicher vom wahlfreien Zugriffstyp mit Datenleitungen (MDQi¶i¶), die mit den im Speicherzellenfeld befindlichen lokalen Datenleitungen verbindbar sind, wobei die Datenleitungen (MDQi¶i¶) in Gruppen (U1 bis U8) zusammengefasst sind und mindestens eine Gruppe oder einzelne Datenleitungen der Gruppen durch Redundanzdatenleitungen (MDQi¶R¶) ausgebildet sind, sowie mit aus dem Speicher in Gruppen (IO1 bis IO4) heraus führenden Ein/Ausgabeleitungen ("IO = Input/Output"), wobei ein in zwei Ebenen organisiertes Bussystem vorgesehen ist, wobei die erste Ebene über Busleistungen (A¶i¶) verfügt, die zum einen mit allen Ein/Ausgabeleitungen (RWDi¶i¶) und zum anderen mit allen Datenleitungen (MDQi¶i¶) verbindbar sind, und die zweite Ebene mehrere einzelne Teil-Busse (B1 bis B4) aufweist, deren Busleitungen (Bi¶i¶) zum einen mit jeweils allen Datenleitungen (MDQi¶i¶) mindestens zweier Gruppen von Datenleitungen und zum anderen mit allen Ein/Ausgabeleitungen (RWDi¶i¶) jeweils einer Gruppe (IOi) verbindbar sind.
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