主权项 |
1.一种半导体容量装置,其特征为具有:持有第1电压依存性K1之第1半导体容量装置、及持有与前述第1电压依存性K1相反符号的第2电压依存性K2之第2半导体容量装置、及并联或是串联前述第1.第2容量元件之配线层。2.如申请专利范围第1项之半导体容量装置,其中将前述第1半导体容量元件的有效面积设为S1;将前述第2半导体容量元件的有效面积设为S2;当│K1│<│K2│时,被设定为S1>S2。3.如申请专利范围第2项之半导体容量装置,其中│K1S1/(S1+S2)+K2S2/(S1+S2)│<100ppm/V。4.如申请专利范围第2项之半导体容量装置,其中被设定为│K1S1│≒│K2S2│。5.一种半导体装置,其特征为具有:形成申请专利范围第1.2.3或4项的任何项之半导体容量装置的基板、及被形成在前述基板上的电晶体。6.一种半导体容量装置,其特征为:具有第1容量元件、及与前述第1容量元件并联或是串联之第2容量元件;前述第1容量元件具有第1电极层、及对于前述第1电极层为介由绝缘膜而对向配置之第1导电型半导体所形成之2第电极层、及前述第2容量元件具有第3电极层、及对于前述第1电极层为介由绝缘膜而被对向配置的第2导电型半导体所形成之第4电极层。7.如申请专利范围第6项之半导体容量装置,其中前述第1容量元件的前述第1电极层、及前述第2容量元件的前述第3电极层,系为以在同一过程所成膜的同一材质而被形成。8.如申请专利范围第7项之半导体容量装置,其中前述第1容量元件的前述第1电极层、及前述第2容量元件的前述第3电极层,系为以前述第1导电型的半导体而被形成。9.如申请专利范围第7项之半导体容量装置,其中前述第1容量元件的前述第1电极层、及前述第2容量元件的前述第3电极层,系为以前述第2导电型的半导体而被形成。10.如申请专利范围第8或9项之半导体容量装置,其中前述第2电极层中的不纯物浓度系为比前述第1电极层中的不纯物浓度还低;前述第4电极层中的不纯物浓度系为比前述第3电极层中的不纯物浓度还低。11.如申请专利范围第6.7.8或9项的任何项之半导体容量装置,其中前述第1电极层及前述第3电极层,系为经过与前述第2电极层及前述第4电极层对向之位置而被连续形成之1个电极层。12.如申请专利范围第6项之半导体容量装置,其中前述第2电极层系为以前述第1导电型的井区而被形成;前述第4电极层系为以前述第2导电型的井区而被形成。13.如申请专利范围第12项之半导体容量装置,其中前述第1.第2容量元件都是MOS电容器。14.如申请专利范围第6.7.8或9项之半导体容量装置,其中形成前述第1容量元件的前述第2电极层之前述第1导电型半导体、及形成前述第2容量元件的前述第4电极层之前述第2导电型半导体,系为被半导体接合。15.如申请专利范围第6.7.8或9项的任何项之半导体容量装置,其中将前述第1容量元件的前述第1.第2电极层对向之面积设为S1,将前述第2容量元件的前述第3.第4电极层为对向之面积设为S2时,使各面积S1.S2相异。16.如申请专利范围第15项之半导体容量装置,其中将前述第1容量元件的电压依存系数设为K1,将前述第2容量元件的电压依存系数设为K2,当│K1│<│K2│时,成为S1>S2。17.如申请专利范围第15项之半导体容量装置,其中将前述第1容量元件的电压依存系数设为K1,将前述第2容量元件的电压依存系数设为K2,当│K1│>│K2│时,成为S1<S2。18.如申请专利范围第16项之半导体容量装置,其中│K1S1/(S1+S2)+K2S2/(S1+S2)│<(100ppm/V。19.如申请专利范围第17项之半导体容量装置,其中│K1S1/(S1+S2)+K2S2/(S1+S2)│<(100ppm/V。20.如申请专利范围第16项之半导体容量装置,其中│K1S1│≒│K2S2│。21.如申请专利范围第17项之半导体容量装置,其中│K1S1│≒│K2S2│。22.一种半导体装置,其特征为具有:形成如申请专利范围第5.6.7.8.9.10.11.12.13.14.15.16或17项的任何项之半导体容量装置的基板、及被形成在前述基板上,含有汲极领域、源极领域及闸极电极的至少1个电晶体。23.如申请专利范围第22项之半导体装置,其中前述第2电极层、前述第4电极层及前述闸极电极,系为以在同一过程所形成膜的同一材质而被形成。24.如申请专利范围第22项之半导体装置,其中前述至少1个电晶体具有场区氧化膜;前述第1.第2半导体容量装置被形成在前述场区氧化膜上。25.如申请专利范围第22项之半导体装置,其中前述至少1个电晶体,系为前述源极、汲极被形成在前述第1导电型的井区领域;在前述第1容量元件的前述第2电极层,用与离子注入到前述至少1个电晶体之前述第1导电型的井区领域之过程同一过程,注入不纯物离子。26.如申请专利范围第22项之半导体装置,其中前述至少1个电晶体,系为前述源极、汲极被形成在前述第2导电型的井区领域;在前述第2容量元件的前述第4电极层,用与离子注入到前述至少1个电晶体之前述第2导电型的井区领域之过程同一过程;注入不纯物离子。27.如申请专利范围第22项之半导体装置,其中前述至少1个电晶体含有前述源极、汲极被形成在前述第1导电型的井区领域之第1电晶体、及前述源极、汲极被形成在前述第2导电型的井区领域之第2电晶体;在前述第1容量元件的前述第2电极层,用与离子注入到前述第1电晶体之前述第1导电型的井区领域之过程同一过程,注入不纯物离子;在前述第2容量元件的前述第2电极层,用与离子注入到前述第2电晶体之前述第2导电型的井区领域之过程同一过程,注入不纯物离子。图式简单说明:第一图系为本发明第1实施例的半导体容量装置之概略平面图。第二图系为第一图的A-A'断面图。第三图系为第一图、第二图所示的半导体容量装置之等价电路图。第四图系为表示本发明第1实施例的半导体容量装置之容量値的电压依存性之特性图。第五图系为测定第四图中的特性1之实验装置模式图。第六图系为测定第四图中的特性2之实验装置模式图。第七图系为本发明第2实施例的半导体容量装置之概略平面图。第八图系为第七图的A-A"断面图。第九图系为本发明第3实施例的半导体容量装置之概略平面图。第十图系为第九图的A-A'断面图。第十一图系为第九图、第十图所示的半导体容量装置之等价电路图。第十二图系为本发明第4实施例的半导体容量装置之概略平面图。第十三图系为本发明第5实施例的半导体容量装置之概略平面图。第十四图系为表示本发明第6实施例的半导体装置之第1过程之断面图。第十五图系为表示本发明第6实施例的半导体装置之第2过程之断面图。第十六图系为表示本发明第6实施例的半导体装置之第3过程之断面图。第十七图系为表示本发明第6实施例的半导体装置之第4过程之断面图。第十八图系为表示本发明第6实施例的半导体装置之第5过程之断面图。第十九图系为表示本发明第6实施例的半导体装置之第6过程之断面图。第二十图系为表示本发明第6实施例的半导体装置之第7过程之断面图。第二十一图系为本发明第7实施例的半导体容量装置之概略断面图。第二十二图系为本发明第8实施例的半导体装置之电路图。第二十三图系为本发明第8实施例的半导体装置之其他电路图。第二十四图系为本发明第8实施例的半导体装置之另外电路图。第二十五图系为过去半导体容量装置之概略平面图。第二十六图系为第二十五图的A-A'断面图。 |