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发明名称 LAYOUT FOR LOGIC CIRCUIT
摘要
申请公布号 JPH0997842(A) 申请公布日期 1997.04.08
申请号 JP19950253648 申请日期 1995.09.29
申请人 NEC CORP 发明人 KURODA YASUAKI
分类号 H01L21/82;G06F17/50;(IPC1-7):H01L21/82 主分类号 H01L21/82
代理机构 代理人
主权项
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