首页 产品 黄页 商标 征信
会员服务 注册 登录 
全部
 |
企业名
 |
法人/股东/高管
 |
品牌/产品
 |
地址
 |
经营范围
发明名称 METHOD OF LOGIC SIMULATION OF SEMICONDUCTOR INTEGRATED CIRCUIT
摘要
申请公布号 JPH08186178(A) 申请公布日期 1996.07.16
申请号 JP19940339632 申请日期 1994.12.28
申请人 YAMAHA CORP 发明人 KIDO SATOHIKO
分类号 H01L21/82;G06F17/50;(IPC1-7):H01L21/82 主分类号 H01L21/82
代理机构 代理人
主权项
地址
您可能感兴趣的专利
©  2024 传众  czvv.com