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La presente invención se refiere a método para mantener estandarizadas las pulsaciones de datos de lectura con un reloj de datos sincronizados, el cual comprende las etapas de: retrasar las pulsaciones de lectura de datos por un intervalo de tiempo previamente seleccionado para proporcionar pulsaciones normales de datos; aplicar las pulsaciones normales de los datos a un circuito de fase cerrada (PLL), para proporcionar y definir el reloj; generar pulsaciones de datos en respuesta a una señal de control la que indica un error potencialmente incorregible, selectivamente, de acuerdo a una opción previamente seleccionada, pudiendo ser pulsaciones tempranas de datos, que corresponden a la lectura de datos o pulsaciones tardías de datos, que corresponden a pulsaciones siguientes de datos de lectura retrasados; y registrar selectivamente, de acuerdo con la opción mencionada, los bits correspondientes a las pulsaciones de datos tempranos o tardíos, al circuito de corrección de error en un intento por hacer que el error sea corregible.
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